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主要職責(zé) (Key Responsibilities) ? 計(jì)算內(nèi)存架構(gòu)設(shè)計(jì)： 主導(dǎo)面向存內(nèi)/近存計(jì)算場(chǎng)景的NPU宏觀及微觀架構(gòu)設(shè)計(jì)，確保計(jì)算單元與我們的內(nèi)存技術(shù)實(shí)現(xiàn)協(xié)同。 ? 內(nèi)存與計(jì)算的深度融合： 與內(nèi)存設(shè)計(jì)團(tuán)隊(duì)緊密合作，定義NPU與內(nèi)存陣列（Memory Array）之間的高帶寬、低延遲數(shù)據(jù)通路和交互機(jī)制，最大化數(shù)據(jù)本地性優(yōu)勢(shì)。 ? 工作負(fù)載分析與優(yōu)化： 專(zhuān)注于內(nèi)存密集型（Memory-Intensive）AI工作負(fù)載，如推薦系統(tǒng)、向量數(shù)據(jù)庫(kù)、圖計(jì)算、大規(guī)模數(shù)據(jù)分析等，分析其特性并轉(zhuǎn)化為對(duì)硬件架構(gòu)的特定要求。 ? PPA優(yōu)化： 在內(nèi)存產(chǎn)品嚴(yán)格的功耗和散熱預(yù)算（Thermal Budget）下，進(jìn)行性能、功耗、面積（PPA）權(quán)衡與優(yōu)化，實(shí)現(xiàn)業(yè)界能效（TOPS/W）。 ? 系統(tǒng)級(jí)接口定義： 定義和設(shè)計(jì)計(jì)算內(nèi)存產(chǎn)品與主機(jī)（Host CPU/GPU）的接口和通信協(xié)議，尤其關(guān)注并利用CXL (Compute Express Link) 等新興互聯(lián)技術(shù)，確保系統(tǒng)級(jí)的高效集成。 ? ISA與軟件協(xié)同： 與軟件和編譯器團(tuán)隊(duì)合作，定義一套簡(jiǎn)潔高效的指令集（ISA），使上層應(yīng)用能夠無(wú)縫、高效地利用存內(nèi)計(jì)算帶來(lái)的優(yōu)勢(shì)。 ? 前瞻性研究： 跟蹤PIM/PNM領(lǐng)域的最新學(xué)術(shù)研究和行業(yè)動(dòng)態(tài)，探索新的架構(gòu)范式，并將其融入公司的技術(shù)路標(biāo)。 任職基本要求 (Basic Qualifications): ? 計(jì)算機(jī)科學(xué)、電子工程、微電子或相關(guān)領(lǐng)域的碩士或博士學(xué)位。 ? 7年以上的高性能計(jì)算或半導(dǎo)體行業(yè)從業(yè)經(jīng)驗(yàn)。 ? 在以下兩個(gè)領(lǐng)域中，至少精通其一，并對(duì)另一領(lǐng)域有深入的理解： – 高性能處理器/AI加速器架構(gòu)： 豐富的CPU/GPU/NPU架構(gòu)設(shè)計(jì)經(jīng)驗(yàn)。 – 先進(jìn)的內(nèi)存系統(tǒng)架構(gòu)： 深入理解DDR, LPDDR, HBM, 3D-DRAM等內(nèi)存技術(shù)和內(nèi)存控制器（Memory Controller）設(shè)計(jì)。 ? 具備從系統(tǒng)級(jí)需求出發(fā)，進(jìn)行微架構(gòu)定義和PPA建模分析的能力。 ? 熟悉數(shù)字邏輯設(shè)計(jì)流程和Verilog/SystemVerilog。